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Author(s) Nikita Tyunyayev, Aurélien Buchet
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Deadline Geen deadline
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TP7 - Traduction en HDL

Dans cette exercice, on vous demande de synthétiser en HDL le circuit suivant:

https://inginious.info.ucl.ac.be/course/LSINC1102/$common/res/slides_exo.drawio.png

Le simulateur est disponible ici: https://nand2tetris.github.io/web-ide/chip

Ecrivez le circuit équivalent au dessin ci-dessous. Vous avez accès aux portes logiques classiques Not(in,out), And(a,b,out), Or(a,b,out) et Xor(a,b,out).